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輯連接號     
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指具有輯意義的連接符號或文字,例如〝與〞、〝或〞、〝非〞等都是。透過這些輯連接號,可以造出新的語句或輯表示式。
非同步     
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是一種透過資料驅動的電路設計。它不需要一個共通的時鐘來讓每個線路同步,而是當有資料要收送時,線路才開始運作,所以也比較省電。
    
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蒐索尋取。《三國志.卷五八.吳書.陸遜傳》:「遜遣親人韓扁齎表奉報,還,遇敵於沔中,鈔得扁。」
輯資料庫綱目     
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輯資料庫設計的結果,一般都會與所選用的資料庫管理系統相關。
傳統     
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十九世紀中葉以前的輯,以亞里士多德所創的三段論證為主。相對於現代輯。也稱為「古典輯」。
組合輯元件     
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組成組合輯電路內之基本元件。參【組合輯電路】(combinational logic circuit)。
電流模     
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工作於電流模式的輯電路,即多個輸入電晶體的集電極和發射極連在一起,再與另一電晶體的發射極耦合形成電流開關,最後用跟隨器輸出。同【發射極耦合輯】(emitter-coupled logic)。
可程式輯陣列     
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一種通用的多個輸入端和多個輸出端的積體電路,常以陣列方式組成。
輯檔案     
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由一個以上的輯記錄所成的集合。
〔語言、真理與輯〕     
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  〔語言、真理與輯〕係英國輯實徵主義哲學家艾爾(Alfred Jules Ayer, 1910~1991)於一九三六年所完成的重要論著,曾於一九四六年出版修訂版。是由輯實徵論的角度企圖解決包括知識論、道德、美學、及形上學問題的一本書。
  艾爾貫穿本書的立論點,在其對知識的探討中即已形成。首先他認為一項有認知意義的命題應當符合經驗檢證,或是符合輯形式。亦即一項命題可由經驗的角度檢證它為真或假,或者是符合輯的,比如數學命題。除此之外,無法再找到能作為知識成立條件的其他準繩。沿續這樣的觀點,艾爾認為道德語句並沒有認知意義。當人說「你不應當殺人」時,實即只是表達出「你殺人」這樣...
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