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高速緩衝記憶體 - 教育百科
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國家教育研究院辭書
基本資料
| 英文： | memory cache |
| 日期： | 2003年6月 |
| 出處： | 資訊與通信術語辭典 |
辭書內容
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名詞解釋： 為一高速記憶體組作為主記憶體和中央處理單元的橋接。其速度比主記憶體快故可使中央處理單元以更快的速度讀取資料和指令，以提升效能。資料和指令是經由某種預看演算法由主記憶體以整塊的方式傳送。參【CPU高速緩衝記憶體】（CPU cache）。 |
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| 資料來源： | 國家教育研究院_高速緩衝記憶體 |
| 授權資訊： | 資料採「 創用CC-姓名標示- 禁止改作 臺灣3.0版授權條款」釋出 |